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SOT

製品とサービス

製品の紹介
Small Outline Transistorの略語、小外形トランジスタパッチパッケージは、表面実裝型パッケージの1つであり、一般的にピンが8個以下の小外形トランジスタと集積回路である。 製品の特徴

製品の特徴

SOPに対して、SOTは8腳以下のデバイスのパッチパッケージ形式であり、サイズは小さい。

応用
SOTは最も成熟した業(yè)界標準パッケージの一つであり、ホールセンサ、低圧MOSFET管、電源管理チップ、リチウム電子保護チップなどの製品に応用されている。

工蕓の特徴
JEDEC規(guī)格を參照するか、達成してください。
異なる顧客ニーズに対応するために、リードフレーム設計とマルチ仕様パッドサイズをカスタマイズします。
グリーン製造、無鉛工。

信頼性テスト基準
試験基準は77サンプルセル中のゼロ欠陥である
JEDEC前提條件:J-STD-20/JESD 22-A 113
溫度/濕度試験:85°C/85%相対濕度、JEDEC 22-A 101
高圧爐試験:121°C/100%相対濕度/15 PSIG、JEDEC 22-A 102
溫度サイクル試験:-65 ~ 150℃、JEDEC 22-A 104
高溫保存試験:150°C、JEDEC 22-A 103
高加速応力試験:130°C/85% 相対濕度/33.5 PSIA、JEDEC 22-A 110/A 118

序號外型腳數(shù)塑封體長
(D)mm
塑封體寬
(E)mm
塑封體厚
(A2)mm
產品總寬
(E1)mm
腳間距
(e)mm
腳寬
( b)mm
腳長
( L)mm
站高
(A1)mm
最大基島
尺寸mil
最大基島
尺寸um
框架厚度
mm
框架
排列
默認
包裝方式
1SOT23-3L(14R)3L2.92±0.11.60±0.11.10±0.12.80±0.20.950.33-0.500.35-0.600-0.1551×721300×25300.15214×48編帶
2SOT23-3L(Flat PIN)3L2.92±0.11.60±0.11.10±0.13.95±0.050.950.33-0.5051×721300×25300.15214×48編帶
3SOT23-5L(14R)5L2.92±0.11.60±0.11.10±0.12.80±0.20.950.33-0.500.35-0.600-0.1553×721350×18200.15214×48編帶
4SOT23-5L(Flat PIN)5L2.92±0.11.60±0.11.10±0.13.95±0.050.950.33-0.5053×721350×18200.15214×48編帶
5SOT23-6L(14R)6L2.92±0.11.60±0.11.10±0.12.80±0.20.950.33-0.500.35-0.600-0.1542×721066×18280.15214×48編帶
6SOT23-6L(Flat PIN)6L2.92±0.11.60±0.11.10±0.13.95±0.050.950.33-0.5042×721066×18280.15214×48編帶
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